[閒聊] zen 3的inter-connection
https://i.imgur.com/zLi0tZM.jpg
https://i.imgur.com/lrisUF7.jpg
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※ PTT留言評論
※ 發信站: 批踢踢實業坊(ptt.cc), 來自: 218.250.19.197 (香港)
※ PTT 網址
推
6950x
恭喜這位手速最快(?)的獲得50p
推
這送分題 給樓下吧
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一樓就秒答了啊
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intel core i7 6950x die
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比 5950X 多 1000 (誤)
推
https://i.imgur.com/r9f1wBw.jpg小弟才疏學淺，需要解釋XD
實際上可能還會多幾條線，我是猜頂多對角線再拉兩條，不過大致上還是ringbus的形狀 。我是不信anandtech編輯講的zen3用全連結啦，原本兩顆ccx加起來12條變成28條，走線 難度大漲。
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※ 編輯: leung3740250 (218.250.19.197 香港), 11/03/2020 19:40:03
中間那一大塊就是共用的 l3 cache
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其實 zen3 CCD內部長這樣
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來源
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他是不是畫錯了？下面那塊是L3?
推
他不可能畫錯 他是AMD的經理
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確實是L3
推
反正那是示意圖而已
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amd的經理就不能出錯嗎？
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我上面的那張die shot是9號發佈會官方po出來的，更
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何況32MB L3怎麼可能就一小塊
推
那只是示意圖
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看到6950x的die shot就感嘆
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全盛時期的intel 凱到把晶圓留白當高級均熱板
推
下一版會不會學自家RDNA2那樣把快取往周圍放，核心
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放中央?
推
Intel的die shot比較常看到不規則留白
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是真的比較凱還是有原因R?
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手lay完沒辦法填那麼滿吧
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